DDR SDRAM: 두 판 사이의 차이
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== 규격 표준 == |
== 규격 표준 == |
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|style="background:#ffdead; font-weight:bold;"|표준 이름 |
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! 표준 이름 |
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! 메모리 클럭<br /><small>(MHz)</small> |
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! 순환 주기<ref>Cycle time is the inverse of the I/O bus clock frequency; e.g., 1/(100 MHz) = 10 ns per clock cycle.</ref><br /><small>(ns)</small> |
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! 입출력 버스 클럭<br /><small>(MHz)</small> |
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! 데이터 속도<br /><small>(MT/s)</small> |
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! 모듈 이름 |
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! 최고 전송 속도<br /><small>(MB/s)</small> |
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| DDR-200 || 100 || 10 || 100 || 200 ||rowspan="3"| 2.5±0.2 || PC-1600 || 1600 || |
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| DDR-400A<br/>DDR-400B<br/>DDR-400C || 200 || 5 || 200 || 400 || 2.6±0.1 || PC-3200 || 3200 || 2.5-3-3<br/>3-3-3<br/>3-4-4 |
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2012년 10월 7일 (일) 16:44 판
DDR SDRAM(Double data rate synchronous dynamic random access memory)은 컴퓨터에 쓰이는 메모리 집적 회로 계열이다. 클럭 주파수를 높이지 않고도 SDR SDRAM에 비해 대역폭이 거의 두 배나 늘어났다.
JEDEC는 DDR SDRAM의 속도에 대한 표준을 두 가지로 지정하였다. 첫 규격은 메모리 칩에 대한 것이고, 두 번째 규격은 메모리 모듈에 대한 것이다. DDR-SDRAM이 더 나중에 나온 DDR2 SDRAM에 압도당하면서 더 오래된 버전은 DDR1-SDRAM으로 일컫게 되었다.
규격 표준
표준 이름 | 메모리 클럭 (MHz) |
순환 주기[1] (ns) |
입출력 버스 클럭 (MHz) |
데이터 속도 (MT/s) |
VDDQ (V) |
모듈 이름 | 최고 전송 속도 (MB/s) |
타이밍 (CL-tRCD-tRP) |
---|---|---|---|---|---|---|---|---|
DDR-200 | 100 | 10 | 100 | 200 | 2.5±0.2 | PC-1600 | 1600 | |
DDR-266 | 133⅓ | 7.5 | 133⅓ | 266⅔ | PC-2100 | 2133⅓ | ||
DDR-333 | 166⅔ | 6 | 166⅔ | 333⅓ | PC-2700 | 2666⅔ | ||
DDR-400A DDR-400B DDR-400C |
200 | 5 | 200 | 400 | 2.6±0.1 | PC-3200 | 3200 | 2.5-3-3 3-3-3 3-4-4 |
주석
- ↑ Cycle time is the inverse of the I/O bus clock frequency; e.g., 1/(100 MHz) = 10 ns per clock cycle.