SDRAM: 두 판 사이의 차이
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[[DDR SDRAM]]의 보급으로 SDR SDRAM이라는 관례적인 명칭이 주어졌다. SDR은 '''S'''ingle '''D'''ata '''R'''ate 의 약자이다. 이 의미는 기존의 SDRAM 이 각 클록펄스가 상승 또는 하강하는 시점에서 한번만 정보를 전송하는 것에서 나온 명칭이다. |
[[DDR SDRAM]]의 보급으로 SDR SDRAM이라는 관례적인 명칭이 주어졌다. SDR은 '''S'''ingle '''D'''ata '''R'''ate 의 약자이다. 이 의미는 기존의 SDRAM 이 각 클록펄스가 상승 또는 하강하는 시점에서 한번만 정보를 전송하는 것에서 나온 명칭이다. |
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== SDRAM의 세대 == |
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[[파일:Micron 48LC32M8A2-AB.jpg|thumb|right|250px| [[사운드 블라스터 X-Fi|사운드 블라스터 X-Fi 프로]]의 640 메가바이트 사운드 메모리는 [[마이크론 테크놀로지|마이크론]] 48LC32M8A2-75 C SDRAM 칩을 사용하며 133MHz/7.5 나노초 8 비트의 너비로 동작한다<!-- x8 3.3V TSOP-54 CL=3 PC133 --> <ref>{{웹 인용 |
[[파일:Micron 48LC32M8A2-AB.jpg|thumb|right|250px| [[사운드 블라스터 X-Fi|사운드 블라스터 X-Fi 프로]]의 640 메가바이트 사운드 메모리는 [[마이크론 테크놀로지|마이크론]] 48LC32M8A2-75 C SDRAM 칩을 사용하며 133MHz/7.5 나노초 8 비트의 너비로 동작한다<!-- x8 3.3V TSOP-54 CL=3 PC133 --> <ref>{{웹 인용 |
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| 저자 = micron.com}}</ref>]] |
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'''싱글 데이터 레이트 SDRAM'''('''SDR SDRAM''', '''S'''ingle '''D'''ata '''R'''ate '''SDRAM''')은 클럭 사이클 한 개 당 한 개의 커맨드(command)를 받거나 한 워드(word) 만큼의 데이터(data)를 주고받을 수 있는 SDRAM을 말한다. 전형적인 클럭 주파수는 100 및 133 MHz였다. 데이터 버스 사이즈는 4 비트, 8 비트, 16 비트 등으로 다양하였는데, 단 일반적으로 SDR SDRAM 칩들은 64 (non-ECC) 혹은 72 ([[오류 정정 부호|ECC]]) 비트를 한 번에 읽을 수 있는 168 핀 [[DIMM]] 형태로 조립되었다. |
'''싱글 데이터 레이트 SDRAM'''('''SDR SDRAM''', '''S'''ingle '''D'''ata '''R'''ate '''SDRAM''')은 클럭 사이클 한 개 당 한 개의 커맨드(command)를 받거나 한 워드(word) 만큼의 데이터(data)를 주고받을 수 있는 SDRAM을 말한다. 전형적인 클럭 주파수는 100 및 133 MHz였다. 데이터 버스 사이즈는 4 비트, 8 비트, 16 비트 등으로 다양하였는데, 단 일반적으로 SDR SDRAM 칩들은 64 (non-ECC) 혹은 72 ([[오류 정정 부호|ECC]]) 비트를 한 번에 읽을 수 있는 168 핀 [[DIMM]] 형태로 조립되었다. |
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2012년 10월 6일 (토) 20:41 판
SDRAM, 에스디 램은 Synchronous Dynamic Random Access Memory 의 약자이다. SDRAM 은 DRAM 의 발전된 형태이며 보통 DRAM 과는 달리 제어 장치 입력을 클록펄스(Clock Pulse)와 동시에 일어나도록 하는 동기식 DRAM이다.
DDR SDRAM의 보급으로 SDR SDRAM이라는 관례적인 명칭이 주어졌다. SDR은 Single Data Rate 의 약자이다. 이 의미는 기존의 SDRAM 이 각 클록펄스가 상승 또는 하강하는 시점에서 한번만 정보를 전송하는 것에서 나온 명칭이다.
SDRAM의 세대
SDR SDRAM
싱글 데이터 레이트 SDRAM(SDR SDRAM, Single Data Rate SDRAM)은 클럭 사이클 한 개 당 한 개의 커맨드(command)를 받거나 한 워드(word) 만큼의 데이터(data)를 주고받을 수 있는 SDRAM을 말한다. 전형적인 클럭 주파수는 100 및 133 MHz였다. 데이터 버스 사이즈는 4 비트, 8 비트, 16 비트 등으로 다양하였는데, 단 일반적으로 SDR SDRAM 칩들은 64 (non-ECC) 혹은 72 (ECC) 비트를 한 번에 읽을 수 있는 168 핀 DIMM 형태로 조립되었다.
DDR(1) SDRAM
DDR2 SDRAM
DDR3 SDRAM
DDR4 SDRAM
주석
- ↑ micron.com. “SDRAM Part Catalog”.
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이 글은 컴퓨터에 관한 토막글입니다. 여러분의 지식으로 알차게 문서를 완성해 갑시다. |